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| 专利名称 | 集成电路 |
| 申请日 | 2019-02-22 |
| 申请号/专利号 | CN201920224028.1 |
| 专利权人 | 意法半导体（克洛尔2）公司 |
| 申请人 | 意法半导体（克洛尔2）公司 |
| 发明人/设计人 | D·迪塔特 |
| 公告日 | 2019-11-05 |
| 公告号 | CN209592039U |
| 法律状态 | 有效 |
| 专利类型 | 实用新型 |
| 行业分类 | 集成电路 |
摘要
本申请涉及集成电路。提供一种集成电路，包括衬底，该衬底具有至少一个第一域和与至少一个第一域不同的至少一个第二域。在衬底中仅在至少一个第二域的位置处提供富陷阱区域。至少一个第一域的位置不包括富陷阱区域。由此使得限制影响集成电路的所述域的射频组件的谐波失真和串扰。
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