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专利名称一种串行置数的同步置数计数器
申请日2019-01-09
申请号/专利号CN201920030323.3
专利权人昆明理工大学
申请人昆明理工大学
发明人/设计人谢佳明;金建辉;谢鹤龄
公告日2019-09-27
公告号CN209448731U
法律状态有效
专利类型实用新型
行业分类

摘要

本实用新型涉及一种串行置数的同步置数计数器,属于数字电路中任意进制计数器领域。本实用新型包括低位计数器芯片、高位计数器芯片和控制电路,低位计数器芯片的信号输入端外接计数信号,低位计数器芯片的进位标志位端连接到控制电路输入端,用以传输低位进位信号,控制电路的进位输出端连接到高位计数器芯片的信号输入端,用以传输高位计数信号,高位计数器芯片和位计数器芯片的预设进制数端分别到控制电路的输入端,分别用以传输高位预设进制信号及低位预设进制信号,同时控制电路的置数状态输出端分别连接到高位计数器芯片和位计数器芯片的置数端,用以传输置数信号。本实用新型利用串行置数实现了同步置数计数器的多位任意进制。
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