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专利名称两相非交叠时钟产生电路
申请日2018-02-06
申请号/专利号CN201810118872.6
专利权人深圳骏通微集成电路设计有限公司
申请人深圳骏通微集成电路设计有限公司
发明人/设计人张常红;曾隆月
公告日2018-06-29
公告号CN108233899A
法律状态审中
专利类型发明
行业分类

摘要

本发明提供了一种两相非交叠时钟产生电路,所述电路包括:用于输入时钟信号的信号输入端,连接输入端以用于调制所述时钟信号以获取第一局部信号的第一时钟电路,连接输入端以用于调制所述时钟信号以获取第二局部信号的第二时钟电路,连接第一时钟电路用于输出第一局部信号的第一输出端,连接第二时钟电路用于输出第二局部信号的第二输出端。本发明叠加线路较少,且一个时钟信号仅经过两次分歧、一次变化之后就输出四个子时钟信号,且四个子时钟信号的输出时延各有不同,在用于控制电路开关的通断方面,能够使节点在同一时刻不受两个电压源的驱动,并且提供提前关断时钟,减小与信号相关的电荷注入效应的影响。
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